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Data Sheet
ADE7953
I 2 C Interface Timing
VDD = 3.3 V ± 10%, AGND = DGND = 0 V, on-chip reference, CLKIN = 3.58 MHz, T MIN to T MAX = ?40°C to +85°C, unless otherwise noted.
Table 3.
Standard Mode
Fast Mode
Parameter
f SCL
t HD;STA
t LOW
t HIGH
t SU;STA
t HD;DAT
t SU;DAT
t R
t F
Description
SCL clock frequency
Hold time for a start or repeated start condition
Low period of SCL clock
High period of SCL clock
Setup time for a repeated start condition
Data hold time
Data setup time
Rise time of SDA and SCL signals
Fall time of SDA and SCL signals
Min 1
0
4.0
4.7
4.0
4.7
0.1
250
Max 1
100
3.45
1000
300
Min 1
0
0.6
1.3
0.6
0.6
0.1
100
20
20
Max 1
400
0.9
300
300
Unit
kHz
μs
μs
μs
μs
μs
ns
ns
ns
t SU;STO
t BUF
t SP
Setup time for stop condition
Bus-free time between a stop and start condition
Pulse width of suppressed spikes
4.0
4.7
N/A
0.6
1.3
50
μs
μs
ns
1
Min and max values are typical minimum and maximum values.
I 2 C Interface Timing Diagram
SDA
t F
t SU;DAT
t HD;STA
t SP
t R
t BUF
SCL
t LOW
t R
t F
START
CONDITION
t HD;STA
t HD;DAT
t HIGH
t SU;STA
REPEATED START
CONDITION
t SU;STO
STOP
START
CONDITION CONDITION
Figure 3. I 2 C Interface Timing
Rev. B | Page 7 of 72
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